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> 一种高速I2C总线从器件接口IP核的设计与实现
一种高速I2C总线从器件接口IP核的设计与实现
上传用户:
李雪峰
上传日期:2011-08-04
文件类型:PDF
文件大小:1746.90K
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资料介绍
摘要:本文介绍了I2C总线的工作过程,使用图形化设计工具,采用HDL-Verilog高级硬件描述语言按照自顶向下的设计方法完成了I2C从器件模式的IP核设计。通过特殊的设计思路,可实现高速数据传输。对此IP核用FPGA进行了验证,最终把它作为一个独立IP成功的应用于ASIC芯片设计中。
关键词:I2C总线;IP核;FPGA;HDL-Verilog
DOI: 10.3969/j.issn.1005-5517.2011.06.012
标签:
FPGA
,
I2C总线
,
IP核
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